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    High-Throughput Dynamic Time Warping Accelerator for Time-Series Classification With Pipelined Mixed-Signal Time-Domain Computing
    Chen, Z. ; Gu, J.
    In: IEEE Journal of Solid-State Circuits, Jg. 56 (2021-02-01), Heft 2, S. 624-635
    Online academicJournal
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    A rad-hard, low-noise, high-speed, BiFET charge preamplifier for warm liquid calorimetry in the SSC
    Ling, K. Y. ; Van Peteghem, P.M. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 26 (1991), Heft 1, S. 66-69
    Online academicJournal
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    A dynamic-time-warp integrated circuit for a 1000-word speech recognition system
    Kavaler, R.A. ; Lowy, M. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 22 (1987-02-01), Heft 1, S. 3-14
    Online academicJournal
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    A Successive Approximation Recursive Digital Low-Dropout Voltage Regulator With PD Compensation and Sub-LSB Duty Control
    Salem, L.G. ; Warchall, J. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 53 (2018), Heft 1, S. 35-49
    Online academicJournal
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    Current-Mode Full-Duplex Transceiver for Lossy On-Chip Global Interconnects
    Wary, N. ; Mandal, P.
    In: IEEE Journal of Solid-State Circuits, Jg. 52 (2017-08-01), Heft 8, S. 2026-2037
    Online academicJournal
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    The 12-Core POWER8™ Processor With 7.6 Tb/s IO Bandwidth, Integrated Voltage Regulation, and Resonant Clocking
    Fluhr, E. J. ; Baumgartner, S. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 50 (2015), Heft 1, S. 10-23
    Online academicJournal
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    A 1.5 mW 68 dB SNDR 80 Ms/s 2 $\times$ Interleaved Pipelined SAR ADC in 28 nm CMOS
    van der Goes, F. ; Ward, C. M. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 49 (2014-12-01), Heft 12, S. 2835-2845
    Online academicJournal
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    A Wideband Power Amplifier MMIC Utilizing GaN on SiC HEMT Technology
    Campbell, C. ; Lee, C. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 44 (2009-10-01), Heft 10, S. 2640-2647
    Online academicJournal
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    Circuit and Physical Design of the zEnterprise™ EC12 Microprocessor Chips and Multi-Chip Module
    Warnock, J. ; Chan, Y. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 49 (2014), Heft 1, S. 9-18
    Online academicJournal
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    A Switched-Inductor Integrated Voltage Regulator With Nonlinear Feedback and Network-on-Chip Load in 45 nm SOI
    Sturcken, N. ; Petracca, M. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 47 (2012-08-01), Heft 8, S. 1935-1945
    Online academicJournal
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    Circuit and Physical Design Implementation of the Microprocessor Chip for the zEnterprise System
    Warnock, J. ; Chan, Y. H. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 47 (2012), Heft 1, S. 151-163
    Online academicJournal
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    An 800 MS/s Dual-Residue Pipeline ADC in 40 nm CMOS
    Vecchi, D. ; Mulder, J. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 46 (2011-12-01), Heft 12, S. 2834-2844
    Online academicJournal
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  13. Detailansicht für Treffer 13 öffnen
    POWER7™, a Highly Parallel, Scalable Multi-Core High End Server Processor
    Wendel, D. F. ; Kalla, R. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 46 (2011), Heft 1, S. 145-161
    Online academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    High Dynamic Range CMOS Imager Technologies for Biomedical Applications
    Graf, H. G. ; Harendt, C. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 44 (2009), Heft 1, S. 281-289
    Online academicJournal
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  15. Detailansicht für Treffer 15 öffnen
    Introduction to the Special Issue on the 2006 IEEE International Solid-State Circuits Conference
    Warnock, J. D. ; Bidermann, W. R. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 42 (2007), Heft 1, S. 3-6
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    Circuit Design Techniques for a First-Generation Cell Broadband Engine Processor
    Warnock, J. ; Wendel, D. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 41 (2006-08-01), Heft 8, S. 1692-1706
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    Overview of the architecture, circuit design, and physical implementation of a first-generation cell processor
    Pham, D.C. ; Aipperspach, T. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 41 (2006), Heft 1, S. 179-196
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    A delay-encoding-logic array processor for dynamic-programming matching of data sequences
    Ogawa, M. ; Shibata, T.
    In: IEEE Journal of Solid-State Circuits, Jg. 40 (2005-07-01), Heft 7, S. 1578-1582
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  19. Detailansicht für Treffer 19 öffnen
    A 21-mW 8-b 125-MSample/s ADC in 0.09-mm/sup 2/ 0.13-/spl mu/m CMOS
    Mulder, J. ; Ward, C.M. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 39 (2004-12-01), Heft 12, S. 2116-2125
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    A single-chip false target radar image generator for countering wideband imaging radars
    Fouts, D.J. ; Pace, P.E. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 37 (2002-06-01), Heft 6, S. 751-759
    Online academicJournal
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